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Verilog and SystemVerilog Gotchas

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Stuart Sutherland
Springer
2007-6-26
218
USD 124.00
Hardcover
9780387717142

图书标签: 编程   


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发表于2024-11-28

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图书描述

This book will help engineers write better Verilog/SystemVerilog design and verification code as well as deliver digital designs to market more quickly. It shows over 100 common coding mistakes that can be made with the Verilog and SystemVerilog languages. Each example explains in detail the symptoms of the error, the languages rules that cover the error, and the correct coding style to avoid the error. The book helps digital design and verification engineers to recognize, and avoid, these common coding mistakes. Many of these errors are very subtle, and can potentially cost hours or days of lost engineering time trying to find and debug them.

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著者简介

曾就职于华为技术通信公司,目前在某EDA公司亚太区客户支持部门任验证产品技术主管;入行以来,参与过TD-SCDMA基带芯片,千兆无源光网芯片,高性能CPU、网络芯片的硬件辅助验证等多个研发项目,在IC设计及验证领域积累了丰富的实践经验;帮助多家公司优化设计流程,采用高级验证技术,缩短项目的研发周期;发表有《OVM实现了可重用的验证平台》,《AMBA片上总线在SOC芯片设计中的应用》等多篇学术论文,也是《The Verification Cookbook》一书的中文版译者之一;多年来致力于行业技术和产品的应用和推广,对IC设计与验证友深刻的体会和思考.


图书目录


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用户评价

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很实用的一本工程书,可以让新手避免很多语言的 “坑”,提高设计水平。 注意:千万千万不要看中文版!

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我觉得对Verilog而言,是一个很好的代码规范。

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读后感

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花了一个多月基本看完了这本书,从而使我从对SV一无所知到基本熟悉,相比于翻译的外文书,这本应该是一本很好的适合自学的书,书中的比喻很形象,而且有插图说明,很容易理解,对于没有接触过C++的人来讲,可以很快的理解类方面的知识,例外书中的例子非常多,利于读者自己仿真...  

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优点:本书从systemverilog的语法出发,详细介绍了systemverilog在验证方面的强大功能,另外还介绍了OVM验证方法学,可以让读者很快的了解systemverilog的用途,激发读者学习systemverilog的强烈兴趣。书中有很多的实例,可以让初学者更直观的了解和学习systemverilog,同时对q...  

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作为IEEE的标准,SystemVerilog 为设计和验证提供了一个统一的平台。本书从SystemVerilog的语法介绍开始,结合验证方法学的理论,提供了丰富的实例和可借鉴的方法,为读者特别是IC验证工程师开阔了视野,提供了宝贵的实践经验,是一本非常实用的参考手册。 ...

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